蓝芯算力于2026年10月19日的RISC V中国峰会上发布智通融合超节点,推动其RISC V AI方案从芯片、服务器延伸至集群基础设施。 据报道,LX500搭载48个RISC V CPU核心和75 TOPS INT8 AI计算引擎;这些是产品规格,并不等于已验证的集群性能。[1][2] 统一内存架构旨在减少CPU与AI计算单元之间的数据搬运,但超节点的芯片数量、互联方式和实际推理表现尚无足够信息评估。
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研究答案

Create a landscape editorial hero image for this Studio Global article: What did Shenzhen-based Lanxin Computing announce at the 2026 RISC-V China Summit about its converged-computing supernode and CTO Jia Xinxia. Article summary: Lanxin Computing announced its “converged-computing supernode” at the 2026 RISC-V China Summit on October 19, extending its LX500-based platform from individual chips and servers toward cluster-level AI infrastructure.[5. Topic tags: general, general web, user generated, documentation. Style: premium digital editorial illustration, source-backed research mood, clean composition, high detail, modern web publication hero. Use reference image context only for broad subject, composition, and topical grounding; do not copy the exact image. Avoid: logos, brand marks, copyrighted characters, real person likenesses, fake screenshots, UI text, readable text, watermarks,
蓝芯算力在2026年10月19日举行的RISC-V中国峰会上发布“智通融合超节点”,将基于LX500的方案从单颗芯片和服务器,进一步延伸至集群级AI算力基础设施。1
2会上,公司首席技术官贾新霞以《LX500:解锁AI推理新路径》为题发表演讲,介绍RISC-V与AI计算融合的技术探索及产品化进展。
1
2
RISC-V是一种开放的指令集架构。蓝芯算力此次发布的重点,不只是采用这一架构,而是尝试将通用计算和AI计算放进同一芯片,并让两类计算单元共享内存资源。
据报道,LX500采用RISC-V架构,集成48个CPU核心,其中32个为性能核、16个为能效核;芯片内还搭载AI Vector和Matrix计算引擎,AI算力为75 TOPS(INT8),并支持从INT4到FP32的多种精度。1
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报道还提到,LX500采用统一内存架构,共享DDR5内存资源,并支持CXL扩展;相关资料也列出RVA23和RVV 1.0兼容性。2
6这些信息属于已报道的产品规格,并非独立基准测试结果。另有报道提及CXL 2.0和最高2TB寻址空间,但峰会报道本身没有提供这些细节。
6
在传统的CPU与独立AI加速器方案中,数据可能需要在不同内存空间之间传输,并经由PCIe等高速互联在计算单元间移动。蓝芯算力提出的思路,是把通用计算和AI计算集成在同一芯片,通过共享内存减少这类数据搬运。2
这套设计面向大模型推理中的首Token延迟、提示词预填充(prefill)和长上下文等场景。2减少数据传输有望降低部分传输开销,但现有报道没有给出这些指标的量化测试结果。因此,架构目标不能直接视为已经证实的性能提升。
此次发布意味着蓝芯算力正尝试把RISC-V AI计算从芯片和服务器扩展到集群层面。1
2不过,目前可查报道没有说明超节点包含多少颗芯片,也未披露节点间采用何种互联设计。缺少这些信息,就难以判断其总体算力、内存拓扑和扩展效率。
LX500此前已有一些产品进展:相关报道提到芯片于2026年2月点亮,搭载该芯片的联想问天WR5219 G5服务器于7月亮相。1
6
14这些节点为产品路线提供了背景,但还不足以说明新发布的超节点在实际工作负载下表现如何。
蓝芯算力此次发布展示了一条将RISC-V从处理器延伸至服务器和AI基础设施的路线。最终能否落地,还要看硬件、软件生态与系统设计能否支撑稳定且有竞争力的部署。行业报道也将能否进入电信、金融和政务等要求较高的核心机房,视为RISC-V服务器平台面临的现实考验。5
现阶段,LX500的公开规格和统一内存思路构成了一项值得关注的产品进展;但要判断超节点的实际竞争力,还需要更多集群配置细节、工作负载级基准测试,以及持续部署的表现。
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蓝芯算力于2026年10月19日的RISC V中国峰会上发布智通融合超节点,推动其RISC V AI方案从芯片、服务器延伸至集群基础设施。
蓝芯算力于2026年10月19日的RISC V中国峰会上发布智通融合超节点,推动其RISC V AI方案从芯片、服务器延伸至集群基础设施。 据报道,LX500搭载48个RISC V CPU核心和75 TOPS INT8 AI计算引擎;这些是产品规格,并不等于已验证的集群性能。[1][2]
统一内存架构旨在减少CPU与AI计算单元之间的数据搬运,但超节点的芯片数量、互联方式和实际推理表现尚无足够信息评估。
蓝芯算力于2026年10月19日的RISC V中国峰会上发布智通融合超节点,推动其RISC V AI方案从芯片、服务器延伸至集群基础设施。 据报道,LX500搭载48个RISC V CPU核心和75 TOPS INT8 AI计算引擎;这些是产品规格,并不等于已验证的集群性能。[1][2] 统一内存架构旨在减少CPU与AI计算单元之间的数据搬运,但超节点的芯片数量、互联方式和实际推理表现尚无足够信息评估。
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2会上,公司首席技术官贾新霞以《LX500:解锁AI推理新路径》为题发表演讲,介绍RISC-V与AI计算融合的技术探索及产品化进展。
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RISC-V是一种开放的指令集架构。蓝芯算力此次发布的重点,不只是采用这一架构,而是尝试将通用计算和AI计算放进同一芯片,并让两类计算单元共享内存资源。
据报道,LX500采用RISC-V架构,集成48个CPU核心,其中32个为性能核、16个为能效核;芯片内还搭载AI Vector和Matrix计算引擎,AI算力为75 TOPS(INT8),并支持从INT4到FP32的多种精度。1
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报道还提到,LX500采用统一内存架构,共享DDR5内存资源,并支持CXL扩展;相关资料也列出RVA23和RVV 1.0兼容性。2
6这些信息属于已报道的产品规格,并非独立基准测试结果。另有报道提及CXL 2.0和最高2TB寻址空间,但峰会报道本身没有提供这些细节。
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在传统的CPU与独立AI加速器方案中,数据可能需要在不同内存空间之间传输,并经由PCIe等高速互联在计算单元间移动。蓝芯算力提出的思路,是把通用计算和AI计算集成在同一芯片,通过共享内存减少这类数据搬运。2
这套设计面向大模型推理中的首Token延迟、提示词预填充(prefill)和长上下文等场景。2减少数据传输有望降低部分传输开销,但现有报道没有给出这些指标的量化测试结果。因此,架构目标不能直接视为已经证实的性能提升。
此次发布意味着蓝芯算力正尝试把RISC-V AI计算从芯片和服务器扩展到集群层面。1
2不过,目前可查报道没有说明超节点包含多少颗芯片,也未披露节点间采用何种互联设计。缺少这些信息,就难以判断其总体算力、内存拓扑和扩展效率。
LX500此前已有一些产品进展:相关报道提到芯片于2026年2月点亮,搭载该芯片的联想问天WR5219 G5服务器于7月亮相。1
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14这些节点为产品路线提供了背景,但还不足以说明新发布的超节点在实际工作负载下表现如何。
蓝芯算力此次发布展示了一条将RISC-V从处理器延伸至服务器和AI基础设施的路线。最终能否落地,还要看硬件、软件生态与系统设计能否支撑稳定且有竞争力的部署。行业报道也将能否进入电信、金融和政务等要求较高的核心机房,视为RISC-V服务器平台面临的现实考验。5
现阶段,LX500的公开规格和统一内存思路构成了一项值得关注的产品进展;但要判断超节点的实际竞争力,还需要更多集群配置细节、工作负载级基准测试,以及持续部署的表现。
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蓝芯算力于2026年10月19日的RISC V中国峰会上发布智通融合超节点,推动其RISC V AI方案从芯片、服务器延伸至集群基础设施。
蓝芯算力于2026年10月19日的RISC V中国峰会上发布智通融合超节点,推动其RISC V AI方案从芯片、服务器延伸至集群基础设施。 据报道,LX500搭载48个RISC V CPU核心和75 TOPS INT8 AI计算引擎;这些是产品规格,并不等于已验证的集群性能。[1][2]
统一内存架构旨在减少CPU与AI计算单元之间的数据搬运,但超节点的芯片数量、互联方式和实际推理表现尚无足够信息评估。