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Cerebras anuncia CS-4, servidor de IA com três chips do tamanho de pratos
O CS 4 combina três processadores WSE 3 Turbo em escala de wafer, cada um aproximadamente do tamanho de um prato de jantar, para acelerar a inferência de chatbots de IA. O sistema usa a arquitetura Nexus, módulos removíveis e novos componentes de rede para agilizar a troca de dados entre os chips.
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Principais conclusões
- O CS 4 combina três processadores WSE 3 Turbo em escala de wafer, cada um aproximadamente do tamanho de um prato de jantar, para acelerar a inferência de chatbots de IA.
- O sistema usa a arquitetura Nexus, módulos removíveis e novos componentes de rede para agilizar a troca de dados entre os chips.
- A Cerebras afirma que o CS 4 pode entregar quatro vezes mais velocidade e 20 vezes mais throughput em determinadas comparações; sua página de produto anuncia até 30 vezes mais velocidade de inferência que sistemas bas...
- A empresa prevê iniciar a disponibilidade no terceiro trimestre, lançar uma geração seguinte em 2027 e alcançar 600 megawatts de capacidade computacional instalada até o fim daquele ano.
Prompt de IA
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A Cerebras Systems apresentou o CS-4, um sistema de inteligência artificial em escala de rack criado para reduzir o tempo de resposta de chatbots. A proposta combina três processadores WSE-3 Turbo — chips em escala de wafer, descritos pela empresa como tendo dimensões comparáveis às de pratos de jantar — em uma alternativa à infraestrutura baseada em GPUs da Nvidia. 2
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O que há dentro do CS-4
O sistema é baseado na arquitetura de servidores Nexus, da Cerebras. Os três WSE-3 Turbo ficam instalados em módulos removíveis, enquanto uma nova camada de componentes de rede foi projetada para acelerar a movimentação de dados entre os processadores. 2
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Os chips são fabricados pela TSMC usando um processo de 5 nanômetros. A Cerebras também afirma que o desenho do CS-4 reduz a quantidade de componentes em comparação com clusters convencionais de GPUs, o que poderia simplificar a implantação e melhorar a economia operacional do sistema. 3
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Promessas de velocidade — e o que elas significam
Segundo a empresa, o CS-4 oferece quatro vezes mais velocidade de desempenho e 20 vezes mais throughput na comparação apresentada. A página oficial do produto usa uma promessa ainda mais ampla: até 30 vezes mais velocidade de inferência em relação a sistemas com GPUs. 13
Esses números são alegações da própria Cerebras, não resultados verificados de forma independente para todos os modelos e tarefas de chatbot. O desempenho real depende do modelo usado, do tipo de carga, do padrão de consultas e da configuração escolhida como referência.
A disputa é relevante porque a inferência — a etapa em que um modelo gera respostas depois de receber uma solicitação — exige cada vez mais capacidade computacional. Ao priorizar velocidade de geração e transferência de dados, a Cerebras tenta se diferenciar do modelo dominante de clusters equipados com GPUs da Nvidia.
Disponibilidade e plano para 2027
A Cerebras informou que o CS-4 deve chegar ao mercado no terceiro trimestre. A empresa também planeja uma geração seguinte de chips WSE-3 Turbo e servidores para 2027. 3
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O CEO Andrew Feldman projetou que a companhia terá 600 megawatts de capacidade computacional instalada até o fim de 2027. 5
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Resultado financeiro recente
O anúncio veio após a divulgação dos resultados mais recentes da empresa. A Cerebras reportou US$ 180,1 milhões em receita GAAP, enquanto seu prejuízo líquido “core”, uma métrica não GAAP, foi de US$ 6,9 milhões. Pelo padrão contábil GAAP, o prejuízo líquido chegou a US$ 450,5 milhões. 1
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Assim, o CS-4 representa tanto uma tentativa de ganhar espaço no mercado de infraestrutura para IA quanto uma aposta para transformar as promessas de desempenho da Cerebras em crescimento comercial.
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O CS 4 combina três processadores WSE 3 Turbo em escala de wafer, cada um aproximadamente do tamanho de um prato de jantar, para acelerar a inferência de chatbots de IA. O sistema usa a arquitetura Nexus, módulos removíveis e novos componentes de rede para agilizar a troca de dados entre os chips.
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