XCENA ne construit pas un GPU plus rapide. Elle développe une mémoire computationnelle qui utilise le standard CXL 3.2 et des milliers de cœurs RISC V pour traiter les données directement dans la mémoire vive (DRAM),...

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L'infrastructure de l'IA cache un secret peu reluisant : déplacer les données entre la mémoire et les processeurs est en train de devenir un goulet d'étranglement bien plus important que la puissance de calcul elle-même. Avec l'explosion de la taille des modèles et des jeux de données, le coût énergétique et la latence de ces allers-retours incessants ont fait de la mémoire un point de blocage critique. Une startup sud-coréenne, XCENA, pense détenir la solution, et des investisseurs viennent de valider sa thèse par un chèque de 135 millions de dollars.
Le 29 mai 2026, XCENA a annoncé une levée de fonds de série B de 135 millions de dollars (environ 202 milliards de wons), pour une valorisation estimée à 570 millions de dollars. Cela porte le financement total de l'entreprise à 185 millions de dollars . Fondée au début de l'année 2022 sous le nom de MetisX avant d'être rebaptisée XCENA fin 2024, la société prévoit d'utiliser ces capitaux pour son expansion internationale, le déploiement chez ses clients et le développement de sa prochaine génération de produits de mémoire computationnelle
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L'idée centrale qui motive cet investissement n'est pas un nouveau concurrent aux cartes graphiques (GPU). XCENA positionne son premier produit, le MX1, dans une catégorie fondamentalement différente : celle d'un dispositif de mémoire computationnelle qui intègre la puissance de traitement directement au niveau de la couche mémoire.
Dans l'architecture classique d'un serveur, quand une donnée doit être traitée, elle effectue un trajet coûteux de la mémoire vive (DRAM) vers le processeur (CPU) ou la carte graphique (GPU), puis revient. Pour les charges de travail d'IA – qu'il s'agisse d'inférence à grande échelle, d'analyse en temps réel ou de requêtes dans des bases de données vectorielles – ces déplacements constants de données provoquent de la latence, consomment de l'énergie et créent un phénomène bien connu dans l'industrie sous le nom de "mur de la mémoire" .
L'intuition fondatrice de XCENA, c'est que beaucoup de ces opérations, très gourmandes en données, n'ont pas besoin de la puissance de calcul parallèle et spécialisée d'un GPU. Les tâches de routine comme le filtrage, la recherche ou l'analyse peuvent être effectuées par des cœurs plus simples et bien plus économes en énergie, placés juste à côté des puces mémoires. On évite ainsi totalement le trajet aller-retour. Cette approche, appelée traitement proche des données (Near-Data Processing, ou NDP), vise à délester le processeur principal plutôt qu'à le remplacer .
Le MX1 est décrit comme le premier produit de mémoire computationnelle au monde à supporter à la fois le standard PCIe 6.0 et le protocole CXL 3.2 . Pour comprendre cette innovation, il faut savoir que CXL (Compute Express Link) est un standard ouvert qui crée une voie express à haute vitesse et faible latence entre les processeurs et la mémoire. C'est donc l'épine dorsale idéale pour un dispositif conçu pour vivre au plus près de la mémoire
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Plutôt qu'un accélérateur monolithique, le MX1 est un équipement rempli de milliers de cœurs RISC-V personnalisés. La documentation de XCENA mentionne des "milliers de cœurs RISC-V à 1,4 GHz" intégrés directement dans le sous-système mémoire . Ces cœurs sont capables d'exécuter sur place des opérations proches de celles d'une base de données (via les bibliothèques logicielles XFLARE de XCENA), traitant ainsi l'information sans jamais la déplacer vers le processeur central
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L'approche technique de XCENA utilise un chemin d'extension séparé, via le bus PCIe 6.0 et adossé à des disques SSD. Cela permet une fonctionnalité que l'entreprise appelle la « Mémoire Infinie » (Infinite Memory). Concrètement, cette technologie peut théoriquement étendre le pool de mémoire accessible par un serveur à une échelle de plusieurs pétaoctets (millions de gigaoctets), en utilisant des SSD rattachés via le protocole CXL. Les applications peuvent ainsi gérer des jeux de données bien plus vastes avec une latence bien inférieure à celle d'un accès traditionnel au stockage .
La feuille de route de l'entreprise révèle un plan d'itération rapide :
Les cartes supportent des barrettes de mémoire DDR5 jusqu'à 256 Go, pour une capacité totale de 1 To, et intègrent des contrôleurs mémoire DDR5-8400 . Lors du salon FMS 2025 (le grand rendez-vous sur l'avenir de la mémoire et du stockage), le MX1 a remporté le prix de la technologie de mémoire computationnelle la plus innovante
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Il est crucial de comprendre ce que XCENA ne fait pas. L'entreprise ne conçoit pas une puce destinée à entraîner des modèles d'IA massifs plus vite que les cartes H100 ou B200 de Nvidia. Le MX1 se positionne comme un coprocesseur pour les opérations qui brassent beaucoup de données, fonctionnant aux côtés des CPU et GPU existants, plutôt que de les remplacer .
Pour l'inférence d'IA, où les modèles doivent scruter en permanence de grands volumes de mémoire, ou pour des charges de travail lourdes en bases de données comme l'analyse en temps réel et les recherches vectorielles, la stratégie de XCENA vise à réduire la charge du processeur principal. Le MX1 prend en charge la partie du travail la plus "gourmande en mémoire", directement à la source. L'objectif est un datacenter où chaque information n'a pas besoin de transiter par les moteurs de calcul les plus chers et les plus énergivores .
La valorisation de 570 millions de dollars associée à cette levée de fonds envoie un signal fort sur la conviction des investisseurs : l'informatique centrée sur la mémoire a un rôle important à jouer dans l'infrastructure de l'IA . Le MX1 est actuellement en cours d'exploration avec des partenaires sélectionnés afin de valider les gains réels de performance et d'efficacité au niveau du système
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Néanmoins, l'histoire de cette validation reste à écrire. Le prix obtenu au salon FMS et les spécifications techniques avancées sont des signaux prometteurs, mais le déploiement en production et des benchmarks indépendants restent le véritable test pour une technologie qui propose de repenser l'architecture d'un élément fondamental des serveurs. Le pari de XCENA est que l'industrie de l'IA est prête à arrêter de déplacer les données, et à commencer à les traiter là où elles se trouvent.
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XCENA ne construit pas un GPU plus rapide. Elle développe une mémoire computationnelle qui utilise le standard CXL 3.2 et des milliers de cœurs RISC V pour traiter les données directement dans la mémoire vive (DRAM),...
XCENA ne construit pas un GPU plus rapide. Elle développe une mémoire computationnelle qui utilise le standard CXL 3.2 et des milliers de cœurs RISC V pour traiter les données directement dans la mémoire vive (DRAM),... La jeune pousse vient de boucler un tour de table de série B de 135 millions de dollars, pour une valorisation de 570 millions, portant son financement total à 185 millions de dollars afin de produire à grande échelle...
La puce MX1, présentée comme le premier produit de mémoire computationnelle au monde compatible PCIe 6.0 et CXL 3.2, a remporté un prix d'innovation au salon FMS 2025, mais sa technologie n'a pas encore fait ses preuv...