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Avec le LX500, Lanxin veut faire passer le RISC-V de la puce au supernœud
Lanxin a dévoilé son supernœud de calcul unifié le 19 octobre, lors du sommet chinois du RISC V 2026. Le LX500 est annoncé avec 48 cœurs RISC V et des moteurs IA affichant 75 TOPS en INT8.
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Points clés à retenir
- Lanxin a dévoilé son supernœud de calcul unifié le 19 octobre, lors du sommet chinois du RISC V 2026.
- Le LX500 est annoncé avec 48 cœurs RISC V et des moteurs IA affichant 75 TOPS en INT8.
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openai.comCreate a landscape editorial hero image for this Studio Global article: What did Shenzhen-based Lanxin Computing announce at the 2026 RISC-V China Summit about its converged-computing supernode and CTO Jia Xinxia. Article summary: Lanxin Computing announced its “converged-computing supernode” at the 2026 RISC-V China Summit on October 19, extending its LX500-based platform from individual chips and servers toward cluster-level AI infrastructure.[5. Topic tags: general, general web, user generated, documentation. Style: premium digital editorial illustration, source-backed research mood, clean composition, high detail, modern web publication hero. Use reference image context only for broad subject, composition, and topical grounding; do not copy the exact image. Avoid: logos, brand marks, copyrighted characters, real person likenesses, fake screenshots, UI text, readable text, watermarks,
Lanxin Computing a présenté son « supernœud de calcul unifié » le 19 octobre, au sommet chinois du RISC-V 2026. L’entreprise veut ainsi étendre son approche fondée sur la puce LX500, du processeur et du serveur jusqu’à une infrastructure d’IA en cluster.1
2 Lors de l’événement, sa directrice technique, Jia Xinxia, a consacré son intervention à « LX500 : ouvrir une nouvelle voie pour l’inférence IA » et aux progrès de l’intégration entre RISC-V et calcul d’IA.
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Une même puce pour le calcul généraliste et l’IA
L’idée défendue par Lanxin est de réunir calcul généraliste et calcul d’IA sur une même puce, avec une mémoire unifiée partagée entre les unités de calcul. Dans un système classique associant processeur et accélérateur distinct, les données doivent circuler entre différents espaces mémoire, notamment via des liaisons comme PCIe. L’architecture du LX500 vise à limiter ces transferts.2
La fiche technique communiquée pour le LX500 mentionne :
- 48 cœurs RISC-V, dont 32 cœurs de performance et 16 cœurs à haute efficacité énergétique ;
- des moteurs vectoriels et matriciels pour l’IA, annoncés à 75 TOPS en INT8 et compatibles avec plusieurs précisions, de l’INT4 au FP32 ;
- une mémoire unifiée, partageant les ressources DDR5 entre le processeur et les unités de calcul IA, avec une extension CXL annoncée ;
- la compatibilité avec RVA23 et RVV 1.0, selon les informations publiées sur la puce.
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Il s’agit de spécifications rapportées, et non de résultats de tests indépendants. Un article détaille aussi une extension CXL 2.0 et une capacité d’adressage pouvant atteindre 2 To ; ces éléments ne sont pas établis par les seuls comptes rendus du sommet.6
Des gains visés sur l’inférence, pas encore chiffrés
Réduire les transferts de données pourrait limiter les échanges entre unités de calcul pendant l’inférence. Lanxin indique que son architecture cible notamment le délai avant la génération du premier jeton, le traitement initial du prompt (prefill) et les requêtes à long contexte.2
Mais les informations publiées ne donnent pas de mesures permettant de quantifier une éventuelle amélioration sur ces usages. Le bénéfice recherché par l’architecture ne doit donc pas être confondu avec un gain de performance déjà démontré.2
Le supernœud reste difficile à évaluer
L’annonce marque une étape supplémentaire : Lanxin présente désormais son approche comme une infrastructure allant de la puce et du serveur jusqu’au calcul en cluster.1
2 En revanche, les comptes rendus disponibles ne précisent ni le nombre de puces dans le supernœud ni la technologie d’interconnexion. Sans ces informations, impossible d’estimer sa puissance totale, l’organisation de sa mémoire ou sa capacité à monter en charge.
Le LX500 avait déjà franchi plusieurs étapes avant cette annonce : sa mise sous tension a été signalée en février 2026, et un serveur Lenovo Wentian WR5219 G5 équipé de la puce a été présenté en juillet.1
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14 Ces jalons éclairent l’avancement du produit, mais ne renseignent pas sur les performances du supernœud en conditions réelles.
Un jalon produit, pas encore un verdict
L’annonce illustre une voie possible pour étendre le RISC-V — une architecture de jeu d’instructions ouverte — des processeurs aux serveurs et aux infrastructures d’IA. Le test décisif reste la capacité du matériel, des logiciels et de la conception système à fonctionner ensemble dans des déploiements fiables et compétitifs. Des observateurs du secteur soulignent également que l’adoption dans des environnements exigeants, comme les télécommunications, la finance ou les administrations, sera un test important pour les serveurs RISC-V.5
Pour l’heure, les caractéristiques annoncées du LX500 et son approche de mémoire unifiée font du supernœud une annonce à suivre. Pour juger de ses performances, il faudra connaître sa configuration complète, disposer de benchmarks sur des charges de travail réelles et observer des déploiements dans la durée.
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Lanxin a dévoilé son supernœud de calcul unifié le 19 octobre, lors du sommet chinois du RISC V 2026.
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Lanxin a dévoilé son supernœud de calcul unifié le 19 octobre, lors du sommet chinois du RISC V 2026. Le LX500 est annoncé avec 48 cœurs RISC V et des moteurs IA affichant 75 TOPS en INT8.