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IBM et Intel préparent l’informatique quantique commerciale, mais le marché reste à prouver
Dans une prépublication, IBM rapporte jusqu’à 63 fois moins de surcoût d’échantillonnage estimé pour l’atténuation des erreurs ; son système tolérant aux fautes Starling reste un objectif pour 2029. Les cellules cryogéniques modulaires d’IBM visent à résoudre le problème du câblage et des interconnexions entre proce...
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Réponse de recherche
Points clés à retenir
- Dans une prépublication, IBM rapporte jusqu’à 63 fois moins de surcoût d’échantillonnage estimé pour l’atténuation des erreurs ; son système tolérant aux fautes Starling reste un objectif pour 2029.
- Les cellules cryogéniques modulaires d’IBM visent à résoudre le problème du câblage et des interconnexions entre processeurs supraconducteurs, tandis qu’Intel travaille sur les qubits de spin en silicium et leur élect...
- Les objectifs de 2029 se multiplient, mais la prévision d’Amazon — cinq à sept ans avant les premières petites machines commercialement utiles — rappelle que la demande et l’économie du quantique restent incertaines.
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L’informatique quantique commerciale ne dépend pas uniquement du nombre de qubits physiques. Il faut aussi maîtriser les erreurs, acheminer les signaux de contrôle dans des systèmes extrêmement froids, relier des processeurs et, surtout, démontrer un avantage suffisant pour qu’un client accepte de payer.
IBM et Intel s’attaquent à des maillons différents de cette chaîne. IBM combine une méthode d’atténuation des erreurs à court terme avec une architecture supraconductrice modulaire. Intel développe des qubits de spin en silicium et envisage le quantique comme un accélérateur spécialisé au sein d’une infrastructure classique.
IBM : écarter les fautes détectables, atténuer les autres
La méthode d’IBM, appelée spacetime probabilistic error cancellation — ou spacetime PEC — associe deux techniques de gestion des erreurs, sans prétendre corriger intégralement toutes les erreurs.
D’abord, une couche de détection fondée sur des codes spatio-temporels utilise des qubits auxiliaires et des contrôles répartis entre les qubits et les étapes temporelles d’un circuit. Les exécutions qui échouent à ces contrôles sont signalées puis écartées par post-sélection. IBM applique ensuite la probabilistic error cancellation (PEC) aux erreurs résiduelles qui n’ont pas été détectées. Cette méthode estime statistiquement ces erreurs en échantillonnant des versions modifiées du circuit, puis en combinant leurs résultats avec des pondérations appropriées.
La nuance est essentielle : il s’agit d’atténuation des erreurs, et non de correction quantique d’erreurs tolérante aux fautes. La technique peut améliorer l’estimation produite par un processeur bruité, mais elle ne transforme pas les qubits physiques actuels en qubits logiques fiables indéfiniment.
Ce qu’IBM a testé — et ce que signifie le facteur 63
Les chercheurs ont testé cette méthode combinée sur le processeur supraconducteur ibm_aachen, dans une simulation du modèle d’Ising à champ transverse. La prépublication indique que le protocole a retrouvé l’aimantation moyenne dans les incertitudes statistiques jusqu’à six étapes de Trotter, tout en réduisant d’un facteur maximal de 63 le surcoût d’échantillonnage estimé, par rapport à une PEC sans post-sélection.
Le chiffre est notable, mais son périmètre est précis. Il compare le coût d’échantillonnage estimé pour cette expérience ; il ne correspond ni à une accélération générale d’un facteur 63, ni à un gain équivalent sur le temps d’exécution total. La post-sélection conduit nécessairement à rejeter une partie des mesures, et la PEC reste tributaire d’une modélisation suffisamment fidèle du bruit pour que la compensation statistique fonctionne. Le résultat est en outre publié sur arXiv, donc sous forme de prépublication, et ne constitue pas encore une démonstration évaluée par les pairs d’un calcul tolérant aux fautes à grande échelle.
En pratique, l’approche dessine une voie intermédiaire : identifier les fautes reconnaissables, éliminer les exécutions correspondantes, puis réserver l’atténuation coûteuse aux erreurs restantes. Elle pourrait étendre le champ des calculs utiles sur des machines bruitées, sans supprimer le besoin, à plus long terme, de correction active des erreurs et de qubits logiques.
Pourquoi IBM repense le « réfrigérateur » quantique
Avec les processeurs supraconducteurs, le refroidissement est aussi une contrainte d’architecture. Chaque qubit réclame des connexions de contrôle et de lecture ; à mesure que les processeurs gagnent en taille, la densité de câblage et les interconnexions deviennent plus difficiles à gérer dans les équipements cryogéniques classiques.
IBM a relié deux cellules cryogéniques en forme de boîtier dans un même environnement de fonctionnement refroidi sous 15 millikelvins, grâce à un tunnel thermiquement blindé qui laisse passer le câblage quantique entre les modules. Chaque cellule repose sur une technologie éprouvée de réfrigération à dilution. Son format, lui, est conçu pour placer les modules côte à côte et offrir davantage d’espace pour le câblage ainsi que pour les connexions entre puces. IBM affirme que l’enceinte sous vide de chaque module procure jusqu’à douze fois plus d’espace de câblage que ses systèmes quantiques les plus utilisés.
L’enjeu commercial est architectural. Plutôt que d’essayer de faire tenir un processeur toujours plus grand dans un seul cryostat aux dimensions contraintes, IBM cherche à relier plusieurs processeurs par des interconnexions courtes et protégées. Cette approche pourrait faciliter l’ajout de puissance de calcul tout en réduisant la complexité de routage associée aux longues connexions externes.
Nighthawk, 1 000 qubits programmables et Starling
IBM prévoit d’installer ses processeurs Nighthawk dans ces systèmes modulaires afin de poursuivre les essais de l’architecture. Sa feuille de route prévoit au moins 1 000 qubits programmables répartis sur des processeurs reliés d’ici à 2027, ainsi qu’IBM Quantum Starling, un système tolérant aux fautes envisagé pour 2029. 17
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Il s’agit d’objectifs de feuille de route, et non de capacités déjà livrées. Ils montrent néanmoins qu’IBM considère la gestion des erreurs, la modularité matérielle, les interconnexions, le câblage et l’exploitation cryogénique comme un seul problème de montée en échelle.
Intel fait un autre pari : le silicium dans une pile de calcul hybride
Le directeur général d’Intel, Lip-Bu Tan, présente les processeurs quantiques comme une troisième catégorie de matériel informatique, appelée à fonctionner aux côtés des CPU et des GPU dans certaines applications. Dans ce modèle, les processeurs classiques et les accélérateurs assurent l’orchestration et les calculs conventionnels, tandis que le processeur quantique n’intervient que sur les tâches pour lesquelles un algorithme quantique peut apporter un avantage réel. 5
C’est une promesse commerciale plus circonscrite que le remplacement de l’informatique classique — et sans doute plus crédible. Un flux de travail quantique devra justifier sa complexité matérielle, logicielle et opérationnelle face aux progrès rapides du calcul haute performance, de l’IA et des méthodes classiques.
Tunnel Falls : une plateforme de recherche à qubits de spin en silicium
Tunnel Falls est un processeur quantique Intel à 12 qubits de spin en silicium, mis à la disposition de la communauté de recherche. Son rôle est d’aider à étudier le fonctionnement des qubits, leur caractérisation, leur fabrication et leur mise à l’échelle à partir de méthodes issues de l’industrie des semi-conducteurs. Intel le présente comme une étape vers un système quantique commercial complet, pas comme un produit commercial en soi.
L’intérêt stratégique des qubits de spin en silicium réside dans leur potentiel de fabricabilité : si la technologie mûrit, elle pourrait s’appuyer sur les procédés et la rigueur industrielle développés pour la production de puces conventionnelles. Mais Tunnel Falls demeure une machine de recherche ; ce potentiel reste à démontrer à l’échelle nécessaire à la tolérance aux fautes.
Horse Ridge II : rapprocher l’électronique de contrôle des qubits
Intel doit également résoudre le problème du contrôle. Horse Ridge II est son projet de puce de contrôle quantique cryogénique, conçu pour renforcer l’intégration entre les qubits et l’électronique classique qui les pilote et les lit. Intel considère le contrôle cryogénique comme un élément central de ses travaux sur les systèmes quantiques ; des publications sur le programme situent le fonctionnement de Horse Ridge II autour de 4 kelvins.
Le fait de rapprocher une partie du contrôle de l’environnement cryogénique vise à réduire la dépendance à de gros faisceaux de câbles partant de la température ambiante — un possible goulot d’étranglement à mesure que les systèmes grandissent. Tunnel Falls et Horse Ridge II montrent ainsi qu’Intel développe à la fois la technologie des qubits et la pile de contrôle qui l’entoure.
Une course encombrée, face à un marché encore non démontré
Les calendriers du secteur convergent vers la fin de la décennie. Microsoft estime que ses travaux sur Majorana 2 soutiennent l’objectif de machines quantiques commercialement utiles d’ici à 2029 ; l’entreprise rapporte pour ce système une durée de vie moyenne des qubits d’environ 20 secondes. Il s’agit de jalons et d’objectifs communiqués par l’entreprise, non de la preuve qu’une machine tolérante aux fautes est déjà déployée commercialement. 2
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Peter DeSantis, dirigeant d’Amazon, adopte une prévision plus prudente : les premiers ordinateurs quantiques de petite taille et commercialement utiles pourraient apparaître dans cinq à sept ans. 6 Cette estimation renvoie plutôt au début des années 2030 et souligne la différence entre un jalon matériel et une valeur économique reproductible.
L’insistance d’Intel sur la correction des erreurs, les applications et la question de savoir qui paiera met en lumière le principal fossé commercial. Davantage de qubits, une meilleure cryogénie et un moindre surcoût d’atténuation sont des avancées nécessaires, mais aucune ne prouve à elle seule l’existence d’une demande. Le test décisif sera de savoir si un flux de travail hybride CPU-GPU-quantique peut apporter un avantage économique vérifié sur un problème client que les systèmes classiques ne résolvent pas aussi efficacement.
À ce stade, la spacetime PEC et la cryogénie modulaire d’IBM, comme les travaux d’Intel sur les qubits de spin en silicium et le matériel de contrôle, représentent des progrès d’ingénierie significatifs. Ils doivent surtout être compris comme des tentatives pour rendre possible un quantique utile — pas comme la preuve que l’informatique quantique largement viable est déjà arrivée.
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Dans une prépublication, IBM rapporte jusqu’à 63 fois moins de surcoût d’échantillonnage estimé pour l’atténuation des erreurs ; son système tolérant aux fautes Starling reste un objectif pour 2029.
Quels sont les points clés à valider en premier ?
Dans une prépublication, IBM rapporte jusqu’à 63 fois moins de surcoût d’échantillonnage estimé pour l’atténuation des erreurs ; son système tolérant aux fautes Starling reste un objectif pour 2029. Les cellules cryogéniques modulaires d’IBM visent à résoudre le problème du câblage et des interconnexions entre processeurs supraconducteurs, tandis qu’Intel travaille sur les qubits de spin en silicium et leur élect...
Que dois-je faire ensuite en pratique ?
Les objectifs de 2029 se multiplient, mais la prévision d’Amazon — cinq à sept ans avant les premières petites machines commercialement utiles — rappelle que la demande et l’économie du quantique restent incertaines.