Qué es la Ley de Escalado Tau (τ) de Huawei y por qué podría cambiar el diseño de chips
Huawei propone la Ley de Escalado Tau (τ), un enfoque que busca mejorar los chips reduciendo el tiempo que tardan las señales en viajar dentro del procesador en lugar de depender únicamente de transistores más pequeños. La arquitectura LogicFolding reorganiza los bloques lógicos del chip para acortar las conexiones...
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Huawei propone la Ley de Escalado Tau (τ), un enfoque que busca mejorar los chips reduciendo el tiempo que tardan las señales en viajar dentro del procesador en lugar de depender únicamente de transistores más pequeños.
La arquitectura LogicFolding reorganiza los bloques lógicos del chip para acortar las conexiones internas y reducir retrasos eléctricos.
La empresa afirma haber diseñado y producido en masa 381 chips basados en este principio durante los últimos seis años.
Huawei cree que esta estrategia podría permitir alcanzar una densidad equivalente a procesos de 1,4 nm hacia 2031, pese a las restricciones tecnológicas externas.
What is Huawei’s newly unveiled Tau (τ) Scaling Law and LogicFolding chip architecture, how does this new principle differ from traditionalHuawei’s Tau (τ) Scaling Law proposes improving semiconductor performance by compressing signal timing inside chips rather than relying only on smaller transistors.
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Durante décadas, el progreso de los semiconductores se ha basado en una idea simple: hacer los transistores cada vez más pequeños. Esa tendencia —popularmente asociada a la Ley de Moore— permitió fabricar chips más potentes y eficientes generación tras generación.
Huawei sostiene que ese camino se está acercando a sus límites. Por eso ha presentado una alternativa centrada no tanto en el tamaño físico de los transistores, sino en la velocidad con la que la información circula dentro del chip.
En el simposio IEEE International Symposium on Circuits and Systems (ISCAS) de 2026, la compañía dio a conocer lo que llama Ley de Escalado Tau (τ) junto con una arquitectura de diseño denominada LogicFolding. La propuesta plantea un cambio de enfoque: pasar del escalado geométrico tradicional a optimizar el tiempo de propagación de las señales dentro de los circuitos.
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Huawei propone la Ley de Escalado Tau (τ), un enfoque que busca mejorar los chips reduciendo el tiempo que tardan las señales en viajar dentro del procesador en lugar de depender únicamente de transistores más pequeños.
¿Cuáles son los puntos clave a validar primero?
Huawei propone la Ley de Escalado Tau (τ), un enfoque que busca mejorar los chips reduciendo el tiempo que tardan las señales en viajar dentro del procesador en lugar de depender únicamente de transistores más pequeños. La arquitectura LogicFolding reorganiza los bloques lógicos del chip para acortar las conexiones internas y reducir retrasos eléctricos.
¿Qué debo hacer a continuación en la práctica?
La empresa afirma haber diseñado y producido en masa 381 chips basados en este principio durante los últimos seis años.
El modelo clásico de evolución de los chips consiste en reducir las dimensiones de los transistores para colocar más en el mismo espacio. Esta estrategia ha guiado a la industria durante décadas.
Huawei propone replantear esa lógica. En lugar de centrarse únicamente en la miniaturización, la Ley de Escalado Tau pone el foco en reducir el tiempo (τ) que tardan los datos y las señales en desplazarse a través del sistema.
Si los datos pueden viajar más rápido dentro del chip, el sistema completo puede ejecutar tareas con mayor eficiencia incluso sin cambios drásticos en el proceso de fabricación. En términos prácticos, esto implicaría pasar de:
Escalado geométrico: mejorar los chips reduciendo el tamaño de los transistores.
Escalado temporal (τ): mejorar el rendimiento reduciendo retrasos y optimizando la comunicación interna del chip.
Según Huawei, comprimir ese tiempo de propagación puede mejorar el rendimiento global y aumentar la densidad efectiva de transistores incluso cuando los nodos de fabricación no avanzan tan rápido.
LogicFolding: la arquitectura que aplica la idea
La Ley Tau se acompaña de un enfoque de diseño denominado LogicFolding. Este método reorganiza los bloques lógicos dentro del procesador para acortar las rutas de conexión internas.
Cuanto más cortos son los cables y las interconexiones dentro de un chip, menor es la resistencia eléctrica y la carga capacitativa que ralentizan las señales. Reducir esas distancias puede disminuir el retraso en la transmisión de datos y mejorar el rendimiento del sistema.
Huawei ha señalado que los próximos procesadores Kirin previstos para 2026 serán los primeros en utilizar esta arquitectura.
La idea encaja con otras tendencias actuales de la industria —como el empaquetado avanzado o la optimización arquitectónica— donde el rendimiento mejora gracias a cómo se organizan y conectan los componentes, no solo gracias a litografías más avanzadas.
Huawei dice que ya lo ha usado en cientos de chips
Aunque la empresa anunció públicamente la Ley Tau en 2026, asegura que el principio ya se ha aplicado internamente durante varios años.
De acuerdo con declaraciones de la compañía recogidas por distintos medios, Huawei ha diseñado y producido en masa 381 chips basados en esta ley durante los últimos seis años, utilizados en áreas como smartphones y computación para inteligencia artificial.
Sin embargo, la empresa no ha divulgado en detalle qué productos concretos incorporaron estas técnicas ni cómo se implementaron exactamente en cada caso.
El objetivo: densidad equivalente a 1,4 nm
Uno de los puntos más llamativos del anuncio es la meta a largo plazo. Huawei afirma que combinando la Ley Tau y LogicFolding podría diseñar chips con densidad de transistores equivalente a un proceso de 1,4 nanómetros alrededor de 2031.
Es importante aclarar que esto no significa que los chips se fabriquen físicamente en 1,4 nm. La empresa sugiere que mejoras en arquitectura y diseño podrían ofrecer resultados comparables en densidad o rendimiento.
Mientras tanto, los fabricantes líderes del sector continúan empujando los límites de la fabricación:
TSMC planea producir chips de 1,4 nm (A14) en torno a 2028.
Samsung ha señalado su objetivo de alcanzar procesos de 1,4 nm hacia 2027.
En ese escenario, la estrategia de Huawei no busca necesariamente liderar la fabricación, sino reducir la distancia mediante innovación en diseño.
Un enfoque estratégico para la industria china
La propuesta llega en un contexto en el que el sector tecnológico chino enfrenta restricciones de exportación que limitan el acceso a algunas de las herramientas de fabricación más avanzadas.
Por ello, Huawei y otras empresas del país han comenzado a explorar formas de mejorar el rendimiento de los chips a través de arquitectura, diseño y optimización del sistema, en lugar de depender exclusivamente de la miniaturización.
Si esta estrategia demuestra ser efectiva, podría ayudar a:
mejorar el rendimiento de procesadores diseñados localmente,
reducir la dependencia de tecnologías extranjeras de fabricación avanzada,
y fortalecer el ecosistema de semiconductores en China.
Lo que aún falta por demostrar
Pese a las promesas, muchos detalles técnicos sobre la Ley Tau y LogicFolding todavía no se han hecho públicos. Huawei no ha publicado documentación completa que describa exactamente cómo se logran estas mejoras a nivel de diseño.
Por ahora, el concepto se entiende mejor como una nueva filosofía de diseño y una hoja de ruta tecnológica, más que como un sustituto plenamente probado del escalado tradicional.
Aun así, el mensaje que envía es claro: si la miniaturización de transistores se ralentiza, la próxima gran frontera del rendimiento podría estar en la arquitectura y en el tiempo que tardan las señales en recorrer un chip.
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