Wie ein solcher Chip genau aussehen würde, ist offen. AMD könnte CPU-IP, Chiplet-Integration, Packaging, Interconnects oder einen anderen Teil des Projekts beisteuern. Keine der vorliegenden Quellen belegt, ob AMD einen vollständigen TPU entwerfen, bestimmte IP-Bausteine liefern oder sich lediglich an der Gehäuse- beziehungsweise Package-Entwicklung beteiligen würde.
AMD verfügt mit dem Instinct MI300A über einen passenden kommerziellen Präzedenzfall. Nach Angaben von AMD kombiniert der Beschleuniger 24 x86-CPU-Kerne auf Zen-4-Basis, 228 CDNA-3-GPU-Recheneinheiten und 128 GB gemeinsamen HBM3-Speicher in einem kohärenten Package.
Der MI300A zeigt damit, dass AMD allgemeine Rechenleistung, Beschleuniger und Speicher mit hoher Bandbreite in einem System integrieren kann. Das macht AMD grundsätzlich zu einem glaubwürdigen Kandidaten für ein Design, bei dem CPU und KI-Beschleuniger Daten möglichst effizient austauschen müssen.
Der MI300A ist allerdings kein Beleg dafür, dass ein gemeldeter Google-TPU dieselben CPU-Kerne, dieselbe Speicherarchitektur, dieselbe Packaging-Technik oder denselben Software-Stack verwenden würde. Er ist ein Hinweis auf vorhandene technische Fähigkeiten – keine Bestätigung des angeblichen Projekts.
Bei klassischen KI-Beschleunigern stehen meist Matrixdurchsatz und Speicherbandbreite im Mittelpunkt. Agentische Systeme benötigen darüber hinaus Rechenleistung für die Koordination einzelner Schritte, die Verwaltung von Werkzeugen, die Bewertung von Zwischenergebnissen und die Reaktion auf sich verändernde Umgebungen. Auch Reinforcement-Learning-Workloads verbinden beschleunigerintensive Berechnungen mit Aufgaben, die eher auf allgemeine Prozessoren angewiesen sind.
Ein möglicher Engpass entsteht, wenn ein Server im Verhältnis zu seinen Beschleunigern zu wenig CPU-Leistung bietet. Eine Lösung wäre ein höheres Verhältnis von CPUs zu Beschleunigern. Eine andere bestünde darin, CPU-Funktionen direkt in das Package des Beschleunigers zu integrieren. Genau in diesem Zusammenhang wird die mögliche Richtung des TPU v10 beschrieben. Die genannten Verhältnisse und die endgültige Architektur sind jedoch keine bestätigten Google-Spezifikationen.
Das AMD-Gerücht passt zu einer breiteren Entwicklung in Googles Custom-Silicon-Ökosystem. Broadcom gilt in Berichten als wichtigster Umsetzungspartner für TPUs und soll unter anderem das physische Design, schnelle Schnittstellen, die Stromversorgung sowie Packaging- und Fertigungskoordination unterstützen.
Unabhängig davon wurde berichtet, dass MediaTek gemeinsam mit Google an einem TPU der siebten Generation arbeitet, während die Beziehung zu Broadcom bestehen bleibt. In diesen Berichten übernimmt Google die Kernarchitektur, MediaTek kümmert sich um I/O- und Peripherieaufgaben; die Fertigung soll 2026 bei TSMC anlaufen.
Die zentrale Schlussfolgerung lautet daher nicht automatisch, dass neue Partner bestehende verdrängen. Google kann Aufgaben nach Generation, Trainings- und Inferenzchip, Chiplet, I/O-Funktion, Packaging-Anforderung oder verfügbarer Fertigungskapazität aufteilen. Eine mögliche Rolle für AMD würde deshalb eher zu einer Strategie mit mehreren Partnern passen als zu einem Beleg dafür, dass Broadcom oder MediaTek aus dem TPU-Geschäft gedrängt wurden.
Googles ausgeweitete Zusammenarbeit mit Marvell ist im Gegensatz zum AMD-Bericht ein offengelegter kommerzieller Datenpunkt. Die Vereinbarung umfasst kundenspezifische Halbleiterprogramme, die an das TPU-Ökosystem angebunden sind. Dazu zählen unter anderem Inferenzbeschleuniger für KI, Speicher- und Netzwerk-Controller, Speicher-Interface-Controller sowie Rechenfunktionen nahe am Speicher.
Marvell räumte Google ein Bezugsrecht auf bis zu 58.970.907 Aktien zu einem Preis von 206,58 US-Dollar je Aktie ein. Bei vollständiger Ausübung hätte dieses Bezugsrecht einen Wert von rund 12,2 Milliarden US-Dollar.
Die Zahl sollte jedoch nicht mit einem sofortigen Auftrag verwechselt werden. Die Ausübung des Bezugsrechts ist an künftige Kaufziele gekoppelt; die Aktien werden in Tranchen abhängig vom Umsatz Marvells mit Google übertragen. Berichte nennen einen möglichen Beschaffungsrahmen von bis zu 120 Milliarden US-Dollar bis zum Geschäftsjahr 2033. Das ist eine an Zielwerte gebundene Obergrenze und keine bedingungslose Bestellung oder unmittelbare Umsatzgarantie.
Der Marvell-Deal stützt somit die übergeordnete These, dass Google seine Lieferkette für eigene KI-Chips vertieft und diversifiziert. Er bestätigt jedoch nicht, dass AMD am TPU v10 beteiligt ist.
Sollte das Projekt existieren und eine nennenswerte Serienproduktion erreichen, könnte AMD einen neuen Zugang zu kundenspezifischen Chips für große Cloud-Anbieter erhalten. Das würde die KI-Chance des Unternehmens über den Verkauf von Instinct-Beschleunigern und EPYC-Prozessoren hinaus erweitern: CPU-IP und Packaging-Kompetenz könnten zu Bestandteilen eines speziell für einen Kunden entwickelten Systems werden.
Die finanziellen Folgen bleiben vollständig spekulativ. Die verfügbaren Berichte nennen weder den Umfang von AMDs möglicher Arbeit noch die wirtschaftlichen Konditionen, die Eigentumsverhältnisse an der IP, den Fertigungspartner, die Packaging-Kapazität, erwartete Stückzahlen oder den Zeitplan. Es gibt daher keine belastbare Grundlage, das Gerücht als bereits verbuchten AMD-Umsatz zu behandeln oder daraus einen konkreten Bewertungseffekt abzuleiten.
Für Google könnte die Zusammenarbeit mit weiteren Lieferanten zusätzliche Designkapazität, mehr Flexibilität bei der Fertigung und eine stärkere Verhandlungsposition bringen. Zugleich ließen sich unterschiedliche Beschleuniger gezielter auf Training, Inferenz und agentische Arbeitslasten zuschneiden.
Für Broadcom und MediaTek könnte ein weiterer Partner zumindest am Rand den Wettbewerbsdruck erhöhen. Verfrüht wäre es jedoch, daraus einen Verlust von Broadcom-Aufträgen, eine Verringerung der Rolle von MediaTek oder eine Veränderung von Googles TPU-Marktanteil abzuleiten. Das bisher berichtete Muster deutet vielmehr darauf hin, dass mehrere Partner gleichzeitig an unterschiedlichen Teilen der Roadmap arbeiten können.
Selbst die gemeldete TPU-Roadmap sieht die Produktion eines TPU-v8-Programms in einem fortschrittlichen Fertigungsprozess erst für Ende 2027 vor. Ein Produkt der v10-Generation würde – sofern die Nummerierung und die Roadmap-Berichte zutreffen – noch später folgen.
Ein heterogener TPU erfordert zudem weit mehr als eine Architekturankündigung. Google und seine Partner müssten die Schnittstelle zwischen CPU und Beschleuniger festlegen, Speicher-Kohärenz und Packaging validieren, das physische Design abschließen, Compiler und Software-Stack anpassen, Fertigungs- und Advanced-Packaging-Kapazitäten sichern, das Silizium testen und den Chip anschließend in Rechenzentren ausrollen.
Ein kurzfristiger Start des TPU v10 erscheint deshalb wenig wahrscheinlich. Die vorsichtige Schlussfolgerung ist ein mehrjähriger Zeitraum nach dem TPU v8 – kein bestätigtes Produktionsdatum.
Das stärkste bestätigte Signal ist Googles fortgesetzte Erweiterung seines Netzwerks für kundenspezifische Chips, einschließlich der offengelegten Vereinbarung mit Marvell. Die Meldung über AMD und den TPU v10 ist deutlich schwächer: Sie beruht auf zugeschriebenen Marktgerüchten und wurde von keinem der beiden Unternehmen bestätigt.
Technisch ist das Gerücht dennoch interessant. Es verbindet AMDs Erfahrung mit CPU-Design und Packaging mit KI-Arbeitslasten, die künftig mehr allgemeine Rechenleistung rund um den Beschleuniger benötigen könnten. Bis Google oder AMD ein konkretes Programm offenlegt, sollten Architektur, wirtschaftlicher Wert, Produktionszeitpunkt und Wettbewerbsfolgen jedoch als offene Fragen gelten.